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3.1.6
Status Check Register (SC)
The status check register is a read-only register containing device status information.
Location
Bit
Address
$0C
Register
SC
7
0
6
TM_B
5
RESERVED
4
IDEN_B
3
OC_INIT_B
2
IDEF_B
1
OFF_B
0
0
3.1.6.1
Test Mode Flag (TM_B)
The test mode bit is cleared if the device is in test mode.
TM_B
0
1
Operating Mode
Test Mode is active
Test Mode is not active
3.1.6.2
Internal Data Error Flag (IDEN_B)
The internal data error bit is cleared if a register data error detection mismatch is detected in the user accessible OTP array.
A device reset is required to clear the error.
IDEN_B
0
1
Error Condition
Error detection mismatch in user programmable OTP array
No error detected
3.1.6.3
Offset Cancellation Init Status Flag (OC_INIT_B)
The offset cancellation initialization status bit is set once the offset cancellation initialization process is complete, and the filter
has switched to normal mode.
OC_INIT_B
0
1
Error Condition
Offset Cancellation in initialization
Offset Cancellation initialization complete (t OC1 and t OC2 expired)
3.1.6.4
Internal Factory Data Error Flag (IDEF_B)
The internal factory data error bit is cleared if a register data CRC fault is detected in the factory programmable OTP array. A
device reset is required to clear the error.
IDEF_B
0
1
Error Condition
CRC error in factory programmable OTP array
No error detected
3.1.6.5
Offset Error Flag (OFF_B)
The offset error flag is cleared if the acceleration signal reaches the offset limit.
OFF_B
0
1
Error Condition
Offset error detected
No error detected
MMA52xxKW
Sensors
18
Freescale Semiconductor, Inc.
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